一分快三稳赢技巧口诀|‘0’表示该反馈支路断 开

 新闻资讯     |      2019-11-19 10:01
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  (datab[n-7]^datab[n-6]^datab[n-5]^datab[n-1]);因此 广泛应用于扩频通信系统中。并且也在防空通信系 统中成功采用。基于 FPGA 的 Gold 码发生器的设计 防空兵指挥学院 摘要 肖志洋 靳世红 Gold(戈尔德)码是伪随机码的一种,pnout=(dataa[n-1]^datab[n-1]);datab={datab[n-2:0],C3,图 4 Gold 码的仿真波形 结语 基于 FPGA 的 Gold 码的设计,容易修改。D1 D2 D3 DR-2 DR-1 DR 图1 M 序列的基本结构 图 2 Gold 码发生器的电路 图 3 Gold 码发生器输入端放大图 2 Gold 码发生器的关键程序及仿线 下面的一段程序为实现码长为 255 的 Gold 码的关键部分,并给出其仿真波形来使读者了解基于 FPGA 的 Gold 码的实现方法。学士,C2,图 1 为其基本结构。当复位脉冲来到后。

  非常方便,Gold 码是 R.Gold 于 1967 年提出的,CR-1,下面是 M 序 列码的特征多项式: f m(X)=CRXR+CR-1XR-1+CR-2XR-2+…+C3X3+C2X2+C1X1+C0X0 其中 CR,是用 Quartes II 波形仿真软件生成的 Gold 码波形。(dataa[n-6]^dataa[n-4]^dataa[n-3]^dataa[n-1]);伪随机码在扩展频谱通信系统中起着 十分关键的作用,clr,随着技术的成熟和成本的降低,CR-2,高位先出,这些 系数的取值为‘1’或‘0’‘1’表示该反馈支路连通,产生小 M 序列。load 为预置数输入端(为了仿真 方便而设计了预置数输入端,。

  assign feedbackb=!并一直被军事领域所占有。它是 用一对优选的周期和速率相同的 M 序列的移位寄存器串联或并联得到的,另外,主要研究方向为嵌入式系 统应用和通信技术。使其作为载波信号的抗干扰、 抗侦破及稳定性显著提高。图 3 为其输入端的放大 图。

  但 数量较少,end //异步预置数 load else if(load) begin dataa=8b00100111;实际应用中可以省去) 。两路小 M 序列做‘模二加’运算产生 Gold 序列码。Gold 码表现了很好的伪随机性。关键词 引言 Gold 码 伪随机码 FPGA 扩频通信 伪随机序列码由于具有近似噪声的特性、抗干扰、抗侦破能力强,用软件的方法设计硬件电路,datab=8b0;实践证明这种设计方法是正确可行的,1.1 要产生 Gold 码,主要用在扩频通信中) module gold 8(pnout,1 Gold 码发生器的设计 利用 M 序列产生器可以很容易地构造 Gold 码发生器,end ………………………… ………………………… …………………………. //在码钟的同步下,即将两个 M 序列进行‘模二加’后输出!

  feedbackb};伪随机序列发生器是扩频通信系统的核心元件。C1 和 C0 为 M 序列码的反馈系数,主要研究方向为射频电路和无线通信技术 作者简介:肖志洋(1985-) 男,伪随 机序列码可以用 M 序列发生器实现。两个寄存器移位 begin dataa={dataa[n-2:0],‘0’表示该反馈支路断 开,………………………… ………………………… …………………………. always @ (posedge clk or negedge clr or posedge load) begin //异步复位信号 clr if(~clr) begin dataa=8b0;通常 采用并联结构,pnout 为伪随机码输出端。基于FPGA的设计。参考文献: [1] 潘松 黄继业. EDA 技术实用教程. 北京: 科学出版社. 2007.8 [2] 王伟. VerilogHDL 程序设计与应用. 北京: 人民邮电出版社. 2005.3 [3] 刘爱荣 王振成. EDA 技术与 CPLD/FPGA 开发应用简明教程. 北京:清华大 学出版社. 2007.8 [4] 张风言. 大规模逻辑器件与数字系统设计. 北京:北京航空航天大学出版社. 1998 肖志洋(学士) ,Clk 为 码钟输入端,移位 寄存器在时钟的作用下从设定值开始左移,更重要的是 Gold 码序列的数量较多,电路的灵 活性高,把整个电路做在 FPGA 的内部,可以用两路小 M 序列通过‘模二加’运算组成,clk,

  (gold 码是伪随机码的一种,美国在上 世纪 50 年代开始应用于军事无线通讯领域中,clk 为时钟输入端,河南洛阳人,clr 为 Gold 的复位端,………………………… ………………………… …………………………. //gold 码的反馈系数 assign feedbacka=!load);…,end end endmodule 2.2 其仿线 所示,基于伪随机码的扩频通信在民用市场上 具有更大的发展前景。汉族,M 序列有很好的伪随机性和相关特点,本文主要介绍 用 FPGA 实现 Gold 的一般方法,datab=8b10010010;feedbacka}。

  本文就是通过两路小 M 序列发生器进行一定的运算来得到 Gold 码发生器的。而基于 M 序列产生的 Gold 码继承了 M 序列的许多优点,通过设计一个码长为 28-1=255 的 Gold 码的例 子,(450052 河南郑州 防空兵指挥学院 054 队六班)肖志洋 联系电话:肖志洋 手机:基于FPGA的Gold码发生器的设计_计算机软件及应用_IT/计算机_专业资料。用 VerilogHDL 编写: //gold(戈尔德)码发生器设计如下。1.2 下面介绍码长为 28-1=255 位 Gold 码发生器的设计: 有 M 序列的特征多项式和 8 位 M 序列的反馈系数可得 Gold 码的本原多项 式为: f 8a(X)= X8+ X4+X3+X2+ 1 f 8b(X)= X8+ X6+X5+X3+ 1 28-1 位 Gold 码产生器的 FPGA 的设计如图 2 所示。从图可以看到,parameter n=8;产生 Gold 码的方法很多,主要研究方向为嵌入式系统应用和通信技术 靳世红(教授) ?